FPGA, ASIC, Digital Design, VHDL ,Verilog, Firmware development, Verifikation
Aktualisiert am 11.11.2020
Profil
Mitarbeiter eines Dienstleisters
Verfügbar ab: 09.11.2020
Verfügbar zu: 100%
davon vor Ort: 50%
Skill-Profil eines fest angestellten Mitarbeiters des Dienstleisters
Deutsch Muttersprache
Englisch: verhandlungssicher

Einsatzorte

Einsatzorte

Deutschland, Österreich, Schweiz
nicht möglich

Projekte

Projekte

1 Jahr 8 Monate
2018-04 - 2019-11

Various Verification tasks for 3D safety camera system

FPGA Entwickler
FPGA Entwickler

Implementation of external memory pre-load to greatly reduce simulation time

annonym
Dresden

Aus- und Weiterbildung

Aus- und Weiterbildung

8 Jahre 1 Monat
1993-10 - 2001-10

Ingnieurstudium, Fakultät Elektrotechnik- und Informationstechnik

Diplom-Ingenieur, Master, TU Dresden
Diplom-Ingenieur, Master
TU Dresden

Position

Position

FPGA Entwicklung, Hardwareentwicklung mit Verilog und VHDL, Digital Design Engineer

Kompetenzen

Kompetenzen

? Electrical and Computer Engineering, Diplomingenieur
? Seit 2002 in der Hardware-Entwicklung mit den Sprachen Verilog and VHDL
? Perl, Python, Tcl Scripting, Git, SVN, Xilinx Vivado, Microsemi Libero
? Sehr gute Kenntnisse im Bereich der digitale Schaltungstechnik

Digitale Schaltungstechnik
Mentor ModelSim und Questa
Tcl Scripting
Hardwarebeschreibung mit Verilog und VHDL RTL-Synthese mit Xilinx Vivado, Microsemi Libero GIT, SVN
Perl, Python

Branchen

Branchen

- Supply Chain & Logistics

- Healthcare & Medical Technology

- Industrial Manufacturing

- Automotive

- Semiconductors

- Aerospace

- Energy

- Public

Einsatzorte

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Deutschland, Österreich, Schweiz
nicht möglich

Projekte

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1 Jahr 8 Monate
2018-04 - 2019-11

Various Verification tasks for 3D safety camera system

FPGA Entwickler
FPGA Entwickler

Implementation of external memory pre-load to greatly reduce simulation time

annonym
Dresden

Aus- und Weiterbildung

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8 Jahre 1 Monat
1993-10 - 2001-10

Ingnieurstudium, Fakultät Elektrotechnik- und Informationstechnik

Diplom-Ingenieur, Master, TU Dresden
Diplom-Ingenieur, Master
TU Dresden

Position

Position

FPGA Entwicklung, Hardwareentwicklung mit Verilog und VHDL, Digital Design Engineer

Kompetenzen

Kompetenzen

? Electrical and Computer Engineering, Diplomingenieur
? Seit 2002 in der Hardware-Entwicklung mit den Sprachen Verilog and VHDL
? Perl, Python, Tcl Scripting, Git, SVN, Xilinx Vivado, Microsemi Libero
? Sehr gute Kenntnisse im Bereich der digitale Schaltungstechnik

Digitale Schaltungstechnik
Mentor ModelSim und Questa
Tcl Scripting
Hardwarebeschreibung mit Verilog und VHDL RTL-Synthese mit Xilinx Vivado, Microsemi Libero GIT, SVN
Perl, Python

Branchen

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- Supply Chain & Logistics

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- Automotive

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